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GPS/GNSS LNAs with Antenna Switch and Bias
Bump Configuration
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MAX2674
MAX2676
V CC
RFIN
GNDDC
A1
B1
C1
A2
B2
C2
RFOUT/SHDN
GNDAC
ANT
Bump Description
6
PIN
A1
A2
B1
B2
C1
C2
NAME
V CC
RFOUT/
SHDN
RFIN
GNDAC
GNDDC
ANT
FUNCTION
V CC . Place bypass capacitor as close as possible to the pin.
RF Output and Shutdown Logic Input. Output match is included on-chip. Couple SHDN logic control
through a 25k I resistor. DC logic-low shuts down the part.
RF Input. Requires a DC-blocking capacitor and an external inductor matching component.
Ground for RF Circuits. Connect to the 2nd layer PCB ground plane with a via next to the pad.
Ground for DC and Bias Circuits. Connect to the 2nd layer PCB ground plane with a via next to the
pad.
Antenna Input
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